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TSC691E 데이터시트(PDF) 6 Page - TEMIC Semiconductors

부품명 TSC691E
상세설명  RT Integer Unit for Embedded Real time 32-bit Computer
PDF  142 Pages
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제조업체  TEMIC [TEMIC Semiconductors]
홈페이지  http://www.temic.de
Logo TEMIC - TEMIC Semiconductors

TSC691E 데이터시트(HTML) 6 Page - TEMIC Semiconductors

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background image
TSC691E
Rev. G (10/09/96)
toc5
MATRA MHS
4. Fault Tolerant and Test Mechanism
107
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4.1. Fault Tolerant and Test Support signals
108
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4.2. Program Flow Control
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4.2.1. Introduction
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4.2.2. Example of Program Flow Control
109
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4.3. Parity Checking
110
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4.3.1. Introduction
110
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.3.2. Trap handling
110
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4.3.3. Priority within hardware traps for IU
111
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4.3.4. Parity Checking on Register File and Control/Status Registers
111
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4.3.5. Parity Checking on Control Signal for the FPU
112
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.3.5.1. Output control signals
112
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4.3.5.2. Input control signals
112
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4.3.6. Parity Checking on Control Pads for the TSC693E (MEC)
112
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.3.6.1. Output control signals
112
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.3.6.2. Input control signals
112
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4.3.7. Parity Checking on Control Pads for the Coprocessor
112
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4.3.8. Parity Generation on ADDRESS Bus
112
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4.3.9. Parity Checking on DATA Bus
112
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.3.10. Non RT 601 Mode
113
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4.3.11. Error Type for external signals parity errors
113
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4.4. Master/checker operation
113
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4.4.1. Basic function
113
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4.4.1.1. Master/Checker Signal description
114
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4.4.1.1.1. MCERR—Comparison Error (output)
114
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.4.1.1.2.CMODE—checker Mode (input)
114
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4.5. IEEE Standard Test Access Port & Boundary-Scan Architecture
114
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4.5.1. TAP
114
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4.5.1.1. TCLK (input)
115
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4.5.1.2. TMS (input)
115
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4.5.1.3. TDI (input)
115
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4.5.1.4. TRST (input)
115
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4.5.1.5. TDO (output)
115
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.2. TAP Controller
115
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4.5.3. The Instruction Register
115
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4.5.3.1. Design and Construction of the instruction register
115
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.3.2. BYPASS Instruction
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.3.3. EXTEST Instruction
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.3.4. INTEST Instruction
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.3.5. SAMPLE/PRELOAD Instruction
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.4. The Device Identification Register
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.5. Internal Scan Path
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5.6. Boundary scan test register
116
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.6.Interleaving register file bits
117
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5. Electrical and Mechanical Specification
118
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5.1. Maximum rating and DC Characteristics
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.1.1. Maximum Ratings
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.1.2. Operating Range
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.1.3. DC Characteristics Over the Operating Range
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.1.4. Capacitance Ratings [7,8]
119
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .



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