TP7660 datasheet(4/6 Pages) ASIC

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电路并联

电路并联：

：

若要降低输出电阻可采用将 TP7660 芯片并联的形式，如下图：

电路级联

电路级联：

：

若要生成较高的输出负电压，可采用芯片级联的形式，如下图：

由于单个芯片的电源效率有限，实际应用中级联的芯片数也是有限的。此种情况下，输

出电阻近似为每个芯片阻值的 n 倍（n 为级联芯片数）。

调节

调节 TP7660 频率

频率

频率：

：

若需提高振荡器的频率可以接入一外部时钟进行过激励，如下图：

需要注意的是，外部时钟的输出端应接 1KΩ的电阻以防自锁。此外由于内部电路结构，

电荷泵频率大小为激励时钟频率的一半。

若要提高电路的转换效率也可适当地降低振荡频率，在 7、8 脚间接一电容，如下图：

TP7660 데이터시트(PDF) 4 Page - Billiton Ltd.